Synopsys首款PCI Express 4.0 IP解决方案助力企业级SoC设计

上网时间: 2014年07月07日? 我来评论 【字号: ? ?小】

关键字:PCI Express 4.0 IP? 企业级SoC设计?

Synopsys日前发布了业界首款完整的PCI Express 4.0 IP解决方案,它由DesignWare PHY、控制器和Verification IP(VIP)组成,专门针对诸如服务器、网络设备、存储系统以及固态硬盘(SSD)等企业级计算应用。PCI Express 4.0是PCI Express I/O的下一代标准,其吞吐量增加了一倍至16 GT/s,目前外围部件互连专业组(PCI-SIG)完成了初步修订0.3版。基于PCI Express 4.0的DesignWare IP使得在SoC中集成PCI Express 4.0规范定义的16GT/s性能和省电功能这些特性时变的更加简单。基于DesignWare IP中已经验证过的、累加起来进入了超过1000项芯片设计的PCI Express3.0、2.1和1.1技术,PCI Express4.0的DesignWare IP使设计人员能够快速地将新的PCI Express4.0功能集成到他们的产品中,同时降低风险并缩短上市时间。

“Synopsys是PCI Express 4.0规范的一个积极、早期的支持者,这种规范为高端服务器和企业级应用提供了关键的性能和功耗改善,”Solarflare公司技术和解决方案营销副总裁Bruce Tolley表示道,“作为智能化应用以太网网络接口软件和硬件领域内的领导者,我们依赖Synopsys为我们提供值得信赖的、支持最新规范的PCI Express IP解决方案。Synopsys对PCI Express 4.0规范的率先支持,再加上该公司业内一流的技术支持,正是我们对领先PCI Express IP供应商所期望的。”

“Teledyne-LeCroy与Synopsys过去一直紧密地合作,以确保PCI Express和M-PCIe的互通作性和标准符合性。”Teledyne-LeCroy公司产品营销经理John Wiedemeier表示道:“为了加速上市时间,设计师需要一种高质量的IP产品来帮助降低将接口整合到其SoC中的风险。我们与Synopsys在最新PCI Express规范上的合作关系加强了各方的生态系统,同时使企业级SoC的设计师能够利用经过验证的解决方案。”

基于PCI Express 4.0的DesignWare PHY IP将支持全功能的分支和聚集,从而为设计师提供了灵活性,既可以将PHY宏配置成运行在2.5、5、8或者16 GT/s等速率下的多个链路,也可以将多达16个通道聚合成一条链路。PHY模拟前端包括了5抽头DFE、连续时间线性均衡(CTLE),以及带有链路初始化和适应先进算法的前馈均衡(FFE),以此来提高传统通道在高速率数据传输下的信号完整性。由于降低功耗是许多市场的关键要求,DesignWare PHY IP将通过包括L1子状态在内的先进技术,将工作功耗和待机功耗同时降低。对分离参考时钟独立SSC(SRIS)的支持将允许使用电缆在系统外实现新级别的PCI Express应用。

基于PCI Express 4.0的低功耗、低延迟DesignWare Controller IP向后兼容PCI Express规范(4.0、3.0、2.1、1.1、M-PCIe和包括L1子状态等可选功能),覆盖了交换开关、端点、双重模式以及根组件等端口类型,同时支持嵌入式DMA和SR-IOV。在DesignWare的PCI Express 4.0控制器IP及前几代产品中,已可提供ARM AMBA 4 AXI、AMBA 3 AXI和AMBA AHB以及原生接口,使设计师能够迅速升级到PCI Express 4.0。基于现有的DesignWare IP架构,基于PCI Express 4.0的DesignWare Controller IP支持多种链路宽度(x1~x16)和多种数据通路位宽,在使门数量达到最低并将设计风险降低的同时,为目标应用提供优化的解决方案。

Synopsys的PCI Express的VerificationIP可以完整的验证基于PCI Express 4.0、3.0、2.1和1.1的所有设计。它是完全可配置的,以支持在PIPE(用于PCI Express的物理接口)或者串行接口上验证PCI Express端点、交换开关和根组件器件。借助这一整套的基于协议、方法学、覆盖率、验证以及高效成品率特性,设计师将能够快速获得PCI Express设计的验证收敛。

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