赛灵思ISE 13.2增加重置功能,提高28nm FPGA验证效率

上网时间: 2011年07月11日? 我来评论 【字号: ? ?小】

关键字:赛灵思? FPGA?

可编程平台厂商赛灵思公司(Xilinx,Inc.)近日宣布推出最新版 ISE? 13.2 设计套件,为28nm 7系列产品,包括将于近期面世的Virtex-7 VX485T提供支持。同时,最新版本的ISE设计套件将采用堆叠硅片互联技术构建的业界最高密度的 Virtex?-7 2000T 器件的设计性能提高了 25%。最新版 ISE 软件还增强了 PlanAhead? 设计分析工具的功能,不仅为 Virtex-7 和 Kintex-7 提供部分重配置功能支持,而且其前端到后端综合项目管理环境提高了 Spartan?-6 FPGA、Virtex-6 FPGA 以及所有三个 7 系列产品的设计效率,包括为低成本的 Artix-7 系列提供初期支持。

利用 PlanAhead 工具提高工作效率

屡获殊荣的 ISE 设计套件可为设计人员提供所需的工具,并帮助他们促进全球设计团队协同设计,快速获得关键设计考虑事项的反馈,掌握 XPower 评估工具实现低功耗优化的最佳实践方法,通过智能时钟门控技术降低动态功耗。所有这些都能通过 PlanAhead 工具实现。

PlanAhead 工具已由业界一流的 I/O 引脚规划器和布局规划器演进为一种可加速投产的综合开发环境,其独特的前端到后端综合环境,可对 RTL 开发、IP 集成、验证、综合、布局布线等每个设计阶段进行设计分析。最终实现功耗、资源利用和性能的快速整合,并减少耗时的设计迭代次数。

赛灵思软件和工具高级市场营销总监 Tom Feist 表示:“PlanAhead 的一大优势在于将创新设计、分析、规划和实现紧密结合在一起,显著提高了设计效率。就传统 FPGA 流程而言,有关关键设计参数的反馈只有在设计流程末期才能获得。而赛灵思将继续高度关注综合和布局布线的运行时间问题,同时我们也认识到减少设计迭代次数同样是加速开发进程的关键所在。确保每次运行时序一致性的预先设计分析和设计保存流程对于我们新型 7 系列器件的客户来说至关重要。”

PlanAhead 工具的增强功能包括新型时钟域互动报告、提示信息语言的本地化以及针对 7 系列倒装片 BGA (FFG) 封装的同步转换输出 (SSO) 支持。升级后的 XPower (XPE) 评估工具使设计人员能够高度准确地预测功耗,赛灵思与TSMC合作开发的高介电层金属闸(HKMG) 高性能低功耗工艺技术与全系列产品所采用的统一 FPGA 架构相结合,实现了同类最低的FPGA功耗,满足典型的设计需求。

本文下一页:即插即用 IP 计划持续向前发展

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