赛灵思ISE 13.2增加重置功能,提高28nm FPGA验证效率

上网时间: 2011年07月11日? 我来评论 【字号: ? ?小】

关键字:赛灵思? FPGA?

即插即用 IP 计划持续向前发展

为进一步推进赛灵思的即插即用 IP 计划,ISE 13.2 设计套件在 CORE Generator? 系统中提供了 AXI(Advance eXtensible Interface) 互联支持,以构建性能更高的点对点架构。设计团队如果构建了自己的符合 AXI 协议的 IP ,那么就能利用可选的 AXI BFM(总线功能模型)验证 IP 来仿真 AXI 互联协议,从而可轻松确保所有接口事件处理都能正确运行(参见《用户指南:AXI 总线功能模型v1.1》)。AXI BFM 目前在 ISim 以及 Cadence、Mentor 和 Synopsys 等仿真器中可用。用户现在还能在面向 Virtex-6和 Spartan-6 FPGA 的设计中通过嵌入式开发套件来访问 AXI_PCIe 核。此外,嵌入式开发套件中的 ChipScope? AXIMonitor 核还能监控 AXI3 接口,并提供可选的 AXI 协议检查器。AXI 协议检查器围绕 ARM SystemVerilog Assertions(SVA)而设计,可支持 39 个 Ready/Valid 握手协议检查。如需了解有关赛灵思采用 AXI 的更多信息,请参阅白皮书:AXI4 互联为即插即用 IP 的发展铺平了道路

第四代部分重配置功能

PlanAhead 现在还向 Kintex-7 和 Virtex-7 系列提供部分重配置支持。部分重配置功能不仅能动态修改逻辑模块,同时还可确保其余逻辑的运行不受干扰。这就意味着设计人员能用 Virtex-7或 Kintex-7 器件来构建在运行的同时可执行功能置换和远程更新的灵活的系统。部分重配置功能还能让设计人员充分利用时分复用技术来实现器件的小型化或减少器件的使用数量,从而显著缩减板级空间并实现比特流存储的最小化,进而降低成本和减小设计尺寸。器件的小型化及使用数量的减少还有助于降低系统功耗,同时,置换出高功耗的任务还能最大程度地降低 FPGA 的动态功耗。将于今年晚些时候推出的最新版 ISE 设计套件将支持 Artix-7 系列,届时赛灵思将首次实现在同代产品中为所有 FPGA 系列提供部分重配置功能。

供货情况与定价

支持 32 位和 64 位Windows 7 操作系统的ISE 13 设计套件的各种版本将立即供货,逻辑版本起价为 2,995 美元。客户可以从赛灵思网站上免费下载全功能 30 天评估版本。

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